FPGA                   PLD

Possono avere routing segmentato o FastTrack. Tipicamente sono realizzati in tecnologia static-RAM o Flash.

Realizzate in tecnologia EEPROM e EECMOS hanno una struttura di routing globale (global routing pool).

I blocchi di logica sono di tipo elementare (non LUT). Tipicamente sono in tecnologia Flash e Antifuse.

Realizzate in tecnologia EEPROM e Flash hanno una struttura di routing a bus (ZIA, PIA, FastConnect).

Le celle logiche sono raggruppate in righe intervallate da canali di routing. Sono in tecnologia Antifuse.

Hanno una struttura di routing a bus gerarchici.
Sono realizzate in tecnologia static-RAM.


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